Please use this identifier to cite or link to this item: http://www.dspace.espol.edu.ec/handle/123456789/31112
Full metadata record
DC FieldValueLanguage
dc.contributor.authorVerinaz Jadan, Herman Isaac-
dc.contributor.authorMartinez Vera, Caril Ronnie-
dc.date.accessioned2015-11-25T00:08:14Z-
dc.date.available2015-11-25T00:08:14Z-
dc.date.issued2015-11-22-
dc.identifier.urihttp://www.dspace.espol.edu.ec/xmlui/handle/123456789/31112-
dc.descriptionEl presente trabajo consiste en el desarrollo de un robot velocista para competencias en el aspecto electrónico, mecánico y de software. El robot diseñado puede alcanzar una velocidad máxima de 2.23 m/s en el circuito de competición, que consiste en un camino cerrado formado por rectas y curvas, las cuales pueden tener un radio mínimo de 10 cm. El computador que controla el robot fue desarrollado sobre la FPGA EP4CE22F17C6N de la familia Cyclone IV de Altera. Para esto se utilizó la tarjeta de desarrollo DE0-Nano. El sistema usa el procesador definido en software NIOS II de Altera y posee periféricos para el manejo del robot. El algoritmo que controla el robot es un sistema de control en cascada. Dos lazos secundarios controlan la velocidad de cada motor y un lazo primario controla cada referencia de acuerdo a la dirección y velocidad central del robot. Además se implementó en software un sistema de filtrado, para esto se usó el algoritmo de Filtrado de Kalman.es_EC
dc.description.abstractThis paper presents the development of a Line Follower Robot for Robotrace Contests; it describes the electronics, mechanics and software design. This robot can reach top speed of 2.23 m/s in the competition circuit, which is a closed path that includes straight lines and curves with a minimum radius of 10 cm. The computer that controls the robot was designed on the Altera Cyclone IV FPGA (EP4CE22F17C6N); we used the DE0-nano Development board. The robot uses the Altera's soft-core processor NIOS II with specific cores for robot control. The control algorithm proposed is a cascade control system. Two secondary loops controls the speed of each motor and a primary loop set each reference variable according with the desired direction and velocity for the robot. Also the system has filter blocks to improve the sensors readings; the algorithm used was the Kalman Filter.es_EC
dc.language.isospaes_EC
dc.publisherESPOLes_EC
dc.rightsopenAccesses_EC
dc.subjectRobot velocistaes_EC
dc.subjectSeguidor de Líneaes_EC
dc.subjectRobot Diferenciales_EC
dc.subjectFPGAes_EC
dc.subjectNIOS IIes_EC
dc.subjectFiltro de Kalmanes_EC
dc.titleDiseño e Implementación de un Robot Velocista de Competencia sobre Plataforma FPGAes_EC
dc.typeArticlees_EC
Appears in Collections:Artículos de Tesis de Grado - FIEC

Files in This Item:
File Description SizeFormat 
Diseño e Implementación de un Robot Velocista de Competencia sobre Plataforma FPGA.pdf414.14 kBAdobe PDFView/Open


Items in DSpace are protected by copyright, with all rights reserved, unless otherwise indicated.